- 著者
- 内田 純平 穴田 一
- 出版者
- 一般社団法人 人工知能学会
- 雑誌
- 人工知能学会第二種研究会資料 (ISSN:24365556)
- 巻号頁・発行日
- vol.2022, no.FIN-028, pp.35, 2022-03-12 (Released:2022-10-21)
In recent years, research on stock trading and foreign exchange trading using technical analysis has been vigorously conducted. In the research on investment strategies using technical analysis, it is popular to construct trading strategies using deep reinforcement learning and neural networks. However, trading strategies constructed by these methods cannot be interpreted because they are not algorithms that take interpretability into account. Therefore, it is difficult to analyze the reasons for the actual trades. In this study, we propose a new algorithm, Weighted Genetic Network Programming, which is an improvement of Full Range Genetic Network Programming, one of the evolutionary computation methods. We propose a new algorithm, Weighted Genetic Network Programming, which is a modification of Full Range Genetic Network Programming, one of the evolutionary computation methods.
- 著者
- 田中 真 内田 純平 宮岡 祐一郎 戸川 望 柳澤 政生 大附 辰夫
- 出版者
- 一般社団法人情報処理学会
- 雑誌
- 情報処理学会論文誌 (ISSN:18827764)
- 巻号頁・発行日
- vol.46, no.6, pp.1383-1394, 2005-06-15
- 被引用文献数
- 11
演算器ごとに専用のローカルレジスタを持たせるレジスタ分散型アーキテクチャを用いると,レジスタ間データ転送を利用することによって配線遅延が回路の性能に与える影響を削減することが可能である.しかし,高位合成のスケジューリングの段階からフロアプラン情報を考慮する必要がある.本論文では,レジスタ分散型をターゲットアーキテクチャとし,(1) スケジューリング,(2) レジスタバインディング,(3) モジュール配置,の工程を繰り返し,(3) から得られたフロアプラン情報を(1),(3) の工程にフィードバックすることによって,解(合成結果)を収束させる高位合成手法を提案する.フロアプラン情報をスケジューリングに反映させるために,フィードバックされた配置情報とタイミング制約に基づいて,レジスタ間データ転送を利用することができるスケジューリング手法を提案する.また,レジスタ分散型に対応したレジスタバインディング手法を提案する.提案バインディング手法では,ローカルレジスタを入力側と出力側で区別し,出力側レジスタで可能な限りデータを保持することにより,総レジスタ数を削減する.提案手法により,フロアプランを考慮したレジスタ間データ転送を用いた回路を解として得ることが可能となる.計算機実験によって,提案手法の有効性を示す.By using a distributed-register architecture, we can synthesize the circuits with register-toregister data transfer, and can reduce influence of interconnect delay. In this paper, we propose a high-level synthesis method targeting a distributed-register architecture. Our method repeats (1) scheduling, (2) register binding, (3) module placement processes, and feeds back floorplan information from (3) to (1) in order to decide which functional units use registertoregister data transfers. Our scheduling algorithm can use register-to-register data transfer based on floorplan and timing constraint. We also propose a register binding algorithm on a distributed-register architecture. We show effectiveness of the proposed methods through experimental results.
- 著者
- 田中 真 内田 純平 宮岡 祐一郎 戸川 望 柳澤 政生 大附 辰夫
- 出版者
- 一般社団法人情報処理学会
- 雑誌
- 情報処理学会論文誌 (ISSN:18827764)
- 巻号頁・発行日
- vol.46, no.6, pp.1383-1394, 2005-06-15
- 参考文献数
- 13
- 被引用文献数
- 11
演算器ごとに専用のローカルレジスタを持たせるレジスタ分散型アーキテクチャを用いると,レジスタ間データ転送を利用することによって配線遅延が回路の性能に与える影響を削減することが可能である.しかし,高位合成のスケジューリングの段階からフロアプラン情報を考慮する必要がある.本論文では,レジスタ分散型をターゲットアーキテクチャとし,(1) スケジューリング,(2) レジスタバインディング,(3) モジュール配置,の工程を繰り返し,(3) から得られたフロアプラン情報を(1),(3) の工程にフィードバックすることによって,解(合成結果)を収束させる高位合成手法を提案する.フロアプラン情報をスケジューリングに反映させるために,フィードバックされた配置情報とタイミング制約に基づいて,レジスタ間データ転送を利用することができるスケジューリング手法を提案する.また,レジスタ分散型に対応したレジスタバインディング手法を提案する.提案バインディング手法では,ローカルレジスタを入力側と出力側で区別し,出力側レジスタで可能な限りデータを保持することにより,総レジスタ数を削減する.提案手法により,フロアプランを考慮したレジスタ間データ転送を用いた回路を解として得ることが可能となる.計算機実験によって,提案手法の有効性を示す.By using a distributed-register architecture, we can synthesize the circuits with register-toregister data transfer, and can reduce influence of interconnect delay. In this paper, we propose a high-level synthesis method targeting a distributed-register architecture. Our method repeats (1) scheduling, (2) register binding, (3) module placement processes, and feeds back floorplan information from (3) to (1) in order to decide which functional units use registertoregister data transfers. Our scheduling algorithm can use register-to-register data transfer based on floorplan and timing constraint. We also propose a register binding algorithm on a distributed-register architecture. We show effectiveness of the proposed methods through experimental results.
- 著者
- 田中 真 内田 純平 宮岡 祐一郎 戸川 望 柳澤 政生 大附 辰夫
- 出版者
- 一般社団法人電子情報通信学会
- 雑誌
- 電子情報通信学会技術研究報告. VLD, VLSI設計技術 (ISSN:09135685)
- 巻号頁・発行日
- vol.104, no.478, pp.127-132, 2004-11-25
- 被引用文献数
- 4
レジスタ分散型アーキテクチャを用いると,レジスタ間データ転送を利用することによって配線遅延が回路の性能に与える影響を削減することが可能であるが,高位合成のスケジューリングの段階からフロアプラン情報を考慮する必要がある.本稿では,レジスタ分散型をターゲットアーキテクチャとし,(1)スケジューリング,(2)レジスタバインディング,(3)モジュール配置,の工程を繰り返し,(3)から得られたフロアプラン情報を(1),(3)の工程にフィードバックすることによって,解(合成結果)を収束させる高位合成手法を提案する.提案手法により,フロアプランを考慮したレジスタ間データ転送を用いた回路を解として得ることが可能となる.また,計算機実験によって,提案手法の有効性を示す.