文献一覧: 島田俊夫 (著者)

2 0 0 0 OA Bayesの定理に基づく検査後確率を利用した日常診療における前立腺特異抗原測定の臨床的意義

著者: 村越大輝久住裕俊小杉山晴香雨宮直樹薗田明広吉村耕治西尾恭規島田俊夫
出版者: 一般社団法人日本臨床衛生検査技師会
雑誌: 医学検査 (ISSN:09158669)
巻号頁・発行日: vol.65, no.4, pp.381-386, 2016-07-25 (Released:2016-09-10)
参考文献数: 12

前立腺癌の罹患率・死亡率は年々増加し,早期診断のためにもPSA測定によるスクリーニング検査の実施は不可欠である。しかし,偽陰性による前立腺癌の見逃し,偽陽性による過剰診断といった問題点があり,前立腺癌と前立腺肥大症の鑑別は困難である。本研究では下部尿路症状を主訴に外来を受診し,前立腺生検を行い,前立腺癌と非前立腺癌の鑑別を病理組織診断により確定し得た患者を対象にROC解析を行い,日常診療におけるPSA測定の有用性を,Bayesの定理を用いて検討した。ROC解析の結果,カットオフ値は15.0 ng/mL,AUCは0.73であった。検査前確率を50%と想定した場合,Bayesの定理に基づいた条件付きの検査後確率は85%まで改善することが判明した。しかし,カットオフ値が4.0 ng/mLの場合,効果的な検査後確率の上昇は認められなかった。すなわちPSAの応用に関しては予防医学と臨床現場との棲み分けを明確に区別し,若年者には予防医学的側面からのアプローチを重視し,高齢者には臨床を重視したアプローチを優先するといった使い分けを行うことでPSA測定の臨床的有用性を効率的に高めることが可能になると考える。したがって,Bayesの定理を用いることで,PSA測定の正当性が明確に評価されると考える。今後,様々な分野における評価法の一つとして広くこの解析法が応用されることを期待する。

2022-11-10 19:11:35
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1 0 0 0 OA 可溶性インターロイキン2受容体(sIL-2R)測定試薬『ルミパルスプレストIL-2R』と『ナノピアIL-2R』の性能評価

著者: 久住裕俊大石祐村越大輝白川るみ平松直樹薗田明広島田俊夫
出版者: 一般社団法人日本臨床衛生検査技師会
雑誌: 医学検査 (ISSN:09158669)
巻号頁・発行日: vol.69, no.4, pp.615-622, 2020-10-25 (Released:2020-10-29)
参考文献数: 13
被引用文献数: 1

可溶性インターロイキン2受容体(soluble interleukin 2 receptor; sIL-2R)は悪性リンパ腫の診断補助や治療効果の判定に有用とされている。本研究では,化学発光酵素免疫測定法(chemiluminescent enzyme immunoassay; CLEIA)を測定原理とした試薬(ルミパルスプレストIL-2R,富士レビオ株式会社)とラテックス免疫比濁法を測定原理とした試薬(ナノピアIL-2R,積水メディカル株式会社)の基礎的性能評価およびCLEIAを測定原理とした従来法である外部委託検査法(デタミナーCL IL-2R,日立化成ダイアグノスティックス・システムズ株式会社)との比較を行い,院内導入における妥当性について評価した。両試薬の基礎的性能は良好であり,日常検査法として十分な性能を有していた。しかし,ナノピアIL-2Rでは非特異反応を示す検体が存在するため,ラテックス免疫比濁法を使用する場合は非特異反応の発生を考慮した上で,回避方法を施して注意深く使用することが望まれる。sIL-2R測定試薬を日常検査法として導入することにより当日の結果報告が可能となることで,即座に治療法を選択することが可能となり臨床への貢献が期待される。

2023-02-26 11:59:40
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1 0 0 0 OA 科学技術計算用データ駆動計算機SIGMA - 1における最適化技法の評価

著者: 平木敬島田俊夫関口智嗣
雑誌: 情報処理学会研究報告計算機アーキテクチャ(ARC)
巻号頁・発行日: vol.1992, no.64(1992-ARC-095), pp.113-118, 1992-08-19

命令レベルデータ駆動計算機SIGMA?1におけるコードの最適化の効果を評価する。コードの最適化手法として、ループをアンフォールド実行するために必要な機能を統合化した命令の導入、ループ不変変数の実現を効率化する手法、命令レベルの負荷分散についてデータ駆動計算機SIGMA?1を用いて評価を行なった。つぎに、大規模なプログラムを安全かつ効率良く並列実行するために必要なプログラム文脈に依存する最適化技法として、非同期性と多重代入、資源の回収と再利用、データ配置、大域データに基づく条件分岐などについて述べた。

2020-02-19 21:01:54
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http://id.nii.ac.jp/1001/00024423/

1 0 0 0 非数値計算応用向けスレッド・レベル並列処理マルチプロセッサ・アーキテクチャSKY

著者: 小林良太郎小川行宏岩田充晃安藤秀樹島田俊夫
出版者: 一般社団法人情報処理学会
雑誌: 情報処理学会論文誌 (ISSN:18827764)
巻号頁・発行日: vol.42, no.2, pp.349-366, 2001-02-15
参考文献数: 25
被引用文献数: 7

近年のマイクロプロセッサは,スーパスカラ・アーキテクチャにより,より多くの命令レベル並列(ILP: Instruction-Level Parallelism)をプログラムより引き出し高性能化を図ってきた.しかし,この方法は,スーパスカラ・プロセッサが引き出すことのできる命令レベル並列の限界や,ハードウェアの複雑さの増加により,限界が見え始めてきた.これを解決する1つの方法は,ILPに加えスレッド・レベル並列(TLP: Thread-Level Parallelism)を利用することである.本論文では,レジスタ値の同期/通信機能を備え,複数のスレッドを並列に実行するSKYと呼ぶマルチプロセッサ・アーキテクチャを提案する.SKYは,非数値計算応用で高い性能を達成することを目的としている.このためには,細粒度のTLPを低オーバヘッドで利用することが要求され,SKYでは,命令ウィンドウ・ベースの同期/通信機構と呼ぶ機構を新たに導入した.この機構は,従来のレジスタ・ベースの同期/通信機構と異なり,受信待ちの命令に後続する命令の実行を可能にするノンブロッキング同期を実現している.これにより,TLPとILPを同時に最大限利用することを可能とする.SPECint95を用いた評価により,8命令発行の2つのスーパスカラ・プロセッサにより構成したSKYは,16命令発行のスーパスカラ・プロセッサに対して,最大46.1%,平均21.8%の高い性能を達成できることを確認した.Current microprocessors have improved performance by exploiting more amount of instruction-level parallelism (ILP) from a program through superscalar architectures.This approach, however,is reaching its limit because of the limited ILP available to superscalar processors and the growth of their hardware complexity.Another approach that solves those problems is to exploit thread-level parallelism (TLP) in addition to ILP.This paper proposes a multiprocessor architecture, called SKY,which executes multiple threads in parallel with a register-value communication and synchronization mechanism.The objective of SKY is to achieve high performance in non-numerical applications.For this purpose, it is required to exploit fine-grain TLP with low overhead.To meet this requirement,SKY introduces an instruction-window-based communication and synchronization mechanism.This mechanism allows subsequent instructions to waiting instructions for receiving registers to be executed unlike previously proposed register-based mechanisms.This capability enables fully exploiting both TLP and ILP.The evaluation results show that SKY with two eight-issue superscalar processors achieves a speedup of up to 46.1% or an average of 21.8% over a 16-issue superscalar processor.